SDLA(시리얼 데이터 링크 분석)

신호 주파수 및 축소 진폭의 가속화로 인해 컴퓨터, 통신 및 메모리 버스를 테스트하는 데 있어 문제가 발생합니다. 텍트로닉스의 고급 시리얼 데이터 링크 분석 솔루션을 통해 제품을 출시하는 데 필요한 특성화, 컴플라이언스 및 디버깅 작업 사이를 원활하게 전환할 수 있습니다.

SDLA Visualizer for MSO/DPO70000 Series Real Time Oscilloscopes : SDLA Visualizer를 통해 전체 측정 회로 제외, 시뮬레이션 회로 포함 및 수신기 평준화 작업을 수행할 수 있습니다. DPOJET 지터 및 아이 분석과 함께 SDLA Visualizer를 사용하면 컴퓨터, 통신 및 메모리 버스에 대해 포괄적인 시뮬레이션 및 측정 환경을 제공할 수 있습니다.

오실로스코프 샘플링을 위한 80SJNB 지터, 타이밍 및 SDLA Visualizer 링크 분석 : 80SJNB를 Tektronix DSA8300 샘플링 오실로스코프 와 함께 사용할 경우 사용자는 SDLA Visualizer 및 DFE/FFE 평준화를 사용한 채널 포함 시 제외 필터, 시간 도메인 파형 또는 S 파라미터를 지정할 수 있습니다. 또한 80SJNB 분석 소프트웨어는 타이밍 및 노이즈 기반 분석을 수행하여 아이 다이어그램 성능을 3D 화면으로 볼 수 있도록 함으로써 50GHz를 초과하는 속도로 신호를 정확하고 심층적으로 평가할 수 있습니다.
MSO/DPO70000 시리즈 실시간 오실로스코프용 SignalCorrect™ 소프트웨어 및 TCS70902 교정 소스 : SignalCorrect™를 사용하면 MSO/DPO70000 스코프에서 TCS70902 빠른 단계 소스 및 캡처된 응답을 통해 케이블, 고정기 및 기타 상호 연결 유형을 빠르게 특성화할 수 있습니다. SignalCorrect는 이 특성화를 기준으로 하여 상호 연결에서 발생하는 손실을 보정하는 제외 필터를 설계할 수 있으며, 플랫 반응을 제공하므로 신호 마진을 복구하여 보다 더 정확한 측정을 수행할 수 있습니다.

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DesignCon 2015 Paper – Hybrid Modeled Measured Characterization of a 320 Gbit/s Backplane System This paper explores a case study of a multilane Ethernet backplane 320 Gbit/s system that is difficult to fully measure and deembed, implements a hybrid method of modeling, deembedding, and …
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PCIe Gen5 Rx Calibration Listen as Joey Chiu, Tektronix PCI Express Applications Engineer, discusses PCI Express Gen5 Receiver (Rx) calibration. He covers how to prepare for it, what to expect, troubleshooting, and how to …
Using SDLA Visualizer Learn how to open closed eyes using equalization techniques and how to de-embed reflections and loss caused by the measurement setup using SDLA Visualizer for Tektronix Real-Time Oscilloscopes.
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PCI Express Gen 4 and Gen 5 Transmitter and Receiver Validation PCI Express I/O bandwidth has doubled every 3 years on average thereby leading to an increased demand for this full duplex high speed bus architecture. As the industry begins deploying the 5.0 …
How to Address Your Toughest Serial Bus Design Challenges with EDA and Measurement Correlation This Tektronix webinar will teach engineers how to use modeling tools to correlate simulations with high-speed physical layer measurements on Serial Bus Standards using the DPO/MSO70000 Series …
DDR5 Memory Characterization While they promise to provide datacenters with large amounts of data at faster speeds and lower power consumption, DDR5 memory devices have unique test challenges. Learn about characterization and …
Advanced Jitter and Noise Analysis As serial data speeds increase, the need to perform accurate timing and jitter measurements is key to staying current in your design role. Check out this new webinar that covers advances in the …